Integral - DDR4 - module - 8 Go - SO DIMM 260 broches - 2666 MHz - PC4-21300 - CL19 - 1.2 V - mémoire s... (IN4V8GNELSI)_1
    • Integral - DDR4 - module - 8 Go - SO DIMM 260 broches - 2666 MHz - PC4-21300 - CL19 - 1.2 V - mémoire s... (IN4V8GNELSI)_1

    Integral - DDR4 - module - 8 Go - SO DIMM 260 broches - 2666 MHz - PC4-21300 - CL19 - 1.2 V - mémoire s... (IN4V8GNELSI)

    IN4V8GNELSI
    Integral

    Integral

    -DDR4
    -module
    -8 Go
    -SO DIMM 260 broches
    -2666 MHz / PC4-21300
    -CL19
    -1.2 V
    -mémoire sans tampon
    -non ECC
    -Poids Brut: 0,02 Kg
    -Sku: 7797737
    23,64 €
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    Description

    Integral

    DDR4module8 GoSO DIMM 260 broches2666 MHz / PC4-21300CL191.2 Vmémoire sans tamponnon ECCPoids Brut: 0,02 Kg
    Détails du produit
    IN4V8GNELSI
    5055288482722
    505528848272
    IN4V8GNELSI
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    Fiche technique

    Général : Description du produit
    Integral - DDR4 - module - 8 Go - SO DIMM 260 broches - 2666 MHz / PC4-21300 - mémoire sans tampon
    Général : Garantie du fabricant
    Garantie limitée à vie (Allemagne, Autriche et France - 10 ans)
    Garantie du fabricant : Service et maintenance
    Garantie limitée à vie (Allemagne, Autriche et France - 10 ans)
    Général : Capacité
    8 Go
    Général : Caractéristiques
    Mémoire sans tampon
    Général : Type de Produit
    Module mémoire
    Mémoire : Technologie
    DDR4 SDRAM
    Mémoire : Format
    SO DIMM 260 broches
    Mémoire : Vitesse
    2666 MHz (PC4-21300)
    Général : Type de mise à niveau
    Générique
    Mémoire : Type
    DRAM module mémoire
    Général : Tension
    1.2 V
    Général : Type de mémoire
    DDR4 SDRAM - SO DIMM 260 broches
    Général : Vérification de l'Intégrité des Données
    Non ECC
    Général : Vitesse
    2666 MHz (PC4-21300)
    Général : Temps de latence
    CL19
    Mémoire : Temps de latence
    CL19
    Mémoire : Vérification de l'Intégrité des Données
    Non ECC
    Mémoire : Fonctions
    Mémoire sans tampon
    Mémoire : Tension
    1.2 V
    Mémoire : Organisation des puces
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